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Prof. Ederson Cichaczewski
Lógica Programável
Aula Prática 2
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2
Aulas teóricas 3 e 4
Conceitos trabalhos
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3
Ferramenta: 
Altera Quartus II Web 13.0 Free
Livro: 
D’AMORE, R. VHDL descrição síntese de circuitos digitais. 2. ed. Rio de Janeiro: LTC, 2012.
Material de apoio:
http://www.ele.ita.br/~damore/vhdl/
Recursos
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1º Exercício – Pacote com 
circuitos somador e mux
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Exercício 9.7.1 – Desenvolver um pacote contendo subprogramas descrevendo as operações realizadas pelos blocos apresentados na figura a seguir: 
O bloco “x” contém um somador completo e um circuito de seleção controlado pelo sinal “qi”. Na condição “qi=1”, o resultado da soma é transferido para a saída “ri+1”, na condição “qi=0” é transferido o sinal “ri”. 
O bloco “y” contém apenas o circuito somador.
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6
Todos os sinais são do tipo “BIT”. O local de 
armazenamento do pacote compilado deve ser 
em uma nova biblioteca criada especialmente 
para esse pacote, denominada “dv_celulas”.
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7
2º Exercício – Registrador 
sensível a nível
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8
Exercício 6.12.1 – Apresente a descrição de um 
registrador sensível em nível de quatro bits:
A entrada dos dados é feita pela entrada “d”. 
A seleção do elemento de memória é feita pela 
entrada “sel” do tipo inteiro. Uma vez 
selecionado o elemento, a saída 
correspondente segue a entrada “d” com “enb
=1”. 
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A informação é mantida nas saídas com 
“enb =0”.
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3º Exercício – Unidade 
lógica e aritmética
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Exercício 11.6.6 – Considere uma unidade lógicaaritmética com oito func ̧ões. A operac ̧ãoexecutada entre os dados “rs” e “ss” é definida pelo sinal “opr”, a saída “ov” indica um transbordo em uma operac ̧ão de soma ou subtração, a saída “zr” indica que o resultado da operac ̧ão é nulo, e entrada “ci” corresponde a um dado do tipo “vem um”.
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Apresente uma descrição VHDL para esse circuito empregando para os sinais “rs” e “ss”, tipo “signed”, com elementos do tipo “bit”, e para os sinais restantes, tipo “bit”. O número de bits dos sinais “rs”, “ss” e “ts” deve ser definido por uma cláusula “GENERIC” no início do código.
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